KZ
bin
Негізгі бет
Қазірдің өзінде танымал
Тікелей эфир
Ұнаған бейнелер
Қайтадан қараңыз
Жазылымдар
Кіру
Тіркелу
Ең жақсы KZbin
Фильм және анимация
Автокөліктер мен көлік құралдары
Музыка
Үй жануарлары мен аңдар
Спорт
Ойындар
Комедия
Ойын-сауық
Тәжірибелік нұсқаулар және стиль
Ғылым және технология
UVM Questions: Can you describe different phases and sub-phases of a UVM component?
12:48
Systemverilog | Test Bench Environment | Half Adder
1:18:39
Enceinte et en Bazard: Les Chroniques du Nettoyage ! 🚽✨
00:21
Mom Hack for Cooking Solo with a Little One! 🍳👶
00:15
伪装成一棵树整蛊妹妹,结果妹妹当场怀疑人生竟要揍我?【两只马儿-恶搞姐妹】
00:57
Quando A Diferença De Altura É Muito Grande 😲😂
00:12
System Verilog Interview Question: Data Types Interview Questions Part 1
Рет қаралды 1,277
Facebook
Twitter
Жүктеу
1
Жазылу 2,2 М.
Ken's Interview Questions
Күн бұрын
Пікірлер: 5
@writetorohit
Жыл бұрын
Hi, Default values of smallest and second_smallest will be 0. So, this function will return only 0. (assuming the array has + numbers)
@paulc139
Жыл бұрын
Integer have four state?
@KenIntQ
Жыл бұрын
yes "integer" data type has 4 states, where as "int" has 2 states.
@Wander_freak
Жыл бұрын
Can’t we directly use array sort method and return array[1]? Which will basically be second smallest after sorting
@rishabhmishra2906
2 ай бұрын
yes we can but complexity would be nlogn where this solution is O(n)
12:48
UVM Questions: Can you describe different phases and sub-phases of a UVM component?
Ken's Interview Questions
Рет қаралды 3,8 М.
1:18:39
Systemverilog | Test Bench Environment | Half Adder
vlsi_training
Рет қаралды 41 М.
00:21
Enceinte et en Bazard: Les Chroniques du Nettoyage ! 🚽✨
Two More French
Рет қаралды 42 МЛН
00:15
Mom Hack for Cooking Solo with a Little One! 🍳👶
5-Minute Crafts HOUSE
Рет қаралды 23 МЛН
00:57
伪装成一棵树整蛊妹妹,结果妹妹当场怀疑人生竟要揍我?【两只马儿-恶搞姐妹】
两只马儿—恶搞姐妹
Рет қаралды 44 МЛН
00:12
Quando A Diferença De Altura É Muito Grande 😲😂
Mari Maria
Рет қаралды 45 МЛН
12:28
Arenas, strings and Scuffed Templates in C
VoxelRifts
Рет қаралды 99 М.
5:57
UVM Question: What is the difference between UVM transaction and UVM sequence item?
Ken's Interview Questions
Рет қаралды 4,8 М.
19:27
virtual sequence & virtual sequencer w.r.p.t system Verilog UVM.
Munsif M. Ahmad
Рет қаралды 12 М.
6:05
System Verilog Constraints And Interview Questions
TechTok
Рет қаралды 7 М.
11:24
System Verilog Interview Question: Write a task to generate a clock with the given frequency in MHz?
Ken's Interview Questions
Рет қаралды 6 М.
12:16
7 Outside The Box Puzzles
MindYourDecisions
Рет қаралды 229 М.
7:42
I solved 541 Leetcode problems. But you need only 150.
Sahil & Sarra
Рет қаралды 2,4 МЛН
13:40
System Verilog - Shallow copy
Sharmi R
Рет қаралды 6 М.
18:20
Systemverilog Data Types Simplified : How to map Verilog Datatypes with those in SV ?
Systemverilog Academy
Рет қаралды 12 М.
20:40
Динамическое программирование | Что это? Как это решать?
Влад Тен
Рет қаралды 3,8 М.
00:21
Enceinte et en Bazard: Les Chroniques du Nettoyage ! 🚽✨
Two More French
Рет қаралды 42 МЛН